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山東省濟寧市高新區
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| ?1-2年? | ?本科? |
?22歲(sui)-38歲(sui)? | ?招(zhao)3~5人(ren)? | ?全職
崗位職責
1、精通硬件描述語言，能夠熟練進行FPGA編程；
2、具有通信設備、視頻圖像處理等算法的FPGA設計實踐經驗；
3、有良好的硬件基礎知識，能獨立完成設計開發任務；
4、負責(ze)有線通信產品(pin)中(zhong)FPGA代碼的編寫及(ji)相關技術(shu)文檔編寫。
崗位要求
1、本科以上學歷，通信工程、電子信息、計算機技術及相關專業；
2、能熟練閱讀英文資料；
3、精通VHDL或Verilog語言；
4、熟悉FPGA的設計和開發流程，具有獨立的FPGA編碼、仿真、調試能力；
5、掌握Xilinx或Altera器件的結構和特點；
6、熟練使用ISE、QuartusII、ModelSim、Matlab等開發工具；
7、熟悉有線通信產品（SDH/MSTP、EPON/GPON、OTN、PTN、WDM等）者優先；
8、具有較強的溝通和協調(diao)能力(li)，做事認(ren)真(zhen)、踏實(shi)、細致，有深厚的團隊協作(zuo)能力(li)。
工作地址
山東(dong)省濟(ji)寧市高(gao)新(xin)區崇(chong)文(wen)大道431號(hao)
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HR信息
褚老師
3日內活躍
人力資源部
自投遞起3個工作日內答復
聊天(tian)意愿
暫無
活躍時段 潛水(shui)
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私(si)營企業
501~1000人
山東省(sheng)濟寧(ning)市(shi)(shi)高新區(qu)(qu)濟寧(ning)市(shi)(shi)高新區(qu)(qu)崇(chong)文大道(dao)431號。
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