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山東省濟寧市高新區
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| ?1-2年? | ?本科? |
?22歲-38歲? | ?招(zhao)3~5人? | ?全職(zhi)
崗位職責
1、精通硬件描述語言,能夠熟練進行FPGA編程;
2、具有通信設備、視頻圖像處理等算法的FPGA設計實踐經驗;
3、有良好的硬件基礎知識,能獨立完成設計開發任務;
4、負(fu)責(ze)有線通信產(chan)品中FPGA代碼(ma)的(de)編寫(xie)及相關技術文檔(dang)編寫(xie)。
崗位要求
1、本科以上學歷,通信工程、電子信息、計算機技術及相關專業;
2、能熟練閱讀英文資料;
3、精通VHDL或Verilog語言;
4、熟悉FPGA的設計和開發流程,具有獨立的FPGA編碼、仿真、調試能力;
5、掌握Xilinx或Altera器件的結構和特點;
6、熟練使用ISE、QuartusII、ModelSim、Matlab等開發工具;
7、熟悉有線通信產品(SDH/MSTP、EPON/GPON、OTN、PTN、WDM等)者優先;
8、具(ju)有較強(qiang)的(de)(de)溝通(tong)和協(xie)調(diao)能力(li),做事認(ren)真、踏實(shi)、細致,有深厚(hou)的(de)(de)團隊協(xie)作(zuo)能力(li)。
工作地址
山(shan)東省濟寧市高新區崇文(wen)大道(dao)431號
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HR信息
褚老師
3日內活躍
人力資源部
自投遞起3個工作日內答復聊(liao)天意愿
暫無
活躍時段 潛水
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私營企業
501~1000人
山東省濟寧市高新區濟寧市高新區崇文大(da)道431號(hao)。
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