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山東省濟寧市高新區
?
| ?3-5年? | ?本科? |
?25歲-40歲? | ?招(zhao)3~5人? | ?全職
崗位職責
1、負責視頻圖像算法,圖像接口,網絡通信在FPGA上實現,負責FPGA詳細設計、測試計劃等相關開發測試文檔編寫;
2、Verilog/VHDL代碼編寫、仿真、時序約束/分析
3、承擔新產品項(xiang)目開發。
崗位要求
1、計算機或相關專業本科學歷以上;
2、3年以上FPGA工作經驗;
3、有PCIE、以太網、USB3.0、RS484、CAN等接口調試經驗,熟悉常用的TCP/IP/CANOPEN/MODBUS等通信協議;
4、有感光芯片圖像采集以及圖像處理經驗,熟悉視頻信號處理算法FPGA實現,如視頻壓縮編解碼算法、視頻縮放算法等優先;
5、有(you)Altera/Xilinx系列(lie)FPGA芯(xin)片開發(fa)經驗,熟(shu)悉QuartusII/ISE/Modelsim等EDA軟件(jian),熟(shu)練掌握Verilog/VHDL語言;
晉升機制
軟(ruan)件開發工程師(shi)高級軟件開發(fa)工程師項目經理(li)項(xiang)目總監CTO系統架構師資深架構師
工作地址
山東省濟寧(ning)市(shi)高新(xin)區第十一工業園
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HR信息
李經理
3日內活躍
人力資源部
自投遞起4個工作日內答復聊(liao)天意愿
暫無
活躍時段 冒(mao)泡 下午7-8點 最活躍(yue)
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機(ji)械/設(she)備/重工
私(si)營企業
50~100人
山東(dong)省濟寧(ning)市高新區第(di)十一工業園
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