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山東省濟寧市高新區
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| ?3-5年(nian)? | ?本科(ke)? |
?25歲(sui)-40歲(sui)? | ?招3~5人? | ?全職
崗位職責
1、負責視頻圖像算法，圖像接口，網絡通信在FPGA上實現，負責FPGA詳細設計、測試計劃等相關開發測試文檔編寫；
2、Verilog/VHDL代碼編寫、仿真、時序約束／分析
3、承(cheng)擔新產品(pin)項(xiang)目開(kai)發。
崗位要求
1、計算機或相關專業本科學歷以上；
2、3年以上FPGA工作經驗；
3、有PCIE、以太網、USB3.0、RS484、CAN等接口調試經驗，熟悉常用的TCP/IP/CANOPEN/MODBUS等通信協議；
4、有感光芯片圖像采集以及圖像處理經驗，熟悉視頻信號處理算法FPGA實現，如視頻壓縮編解碼算法、視頻縮放算法等優先；
5、有(you)Altera/Xilinx系列FPGA芯片開發經驗(yan)，熟悉(xi)QuartusII/ISE/Modelsim等EDA軟件，熟練掌握Verilog/VHDL語言；
晉升機制
軟件開發工程師高級(ji)軟件開發工程師項目經理(li)項(xiang)目總監CTO系統(tong)架構師資深(shen)架構師(shi)
工作地址
山東省(sheng)濟寧市高新區第十一工(gong)業園
展(zhan)開(kai)地圖
HR信息
李經理
3日內活躍
人力資源部
自投遞起4個工作日內答復
聊天意愿
暫無
活躍時段 冒泡(pao) 下(xia)午(wu)7-8點(dian) 最活(huo)躍
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