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山東省濟寧市高新區
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| ?3-5年? | ?本科(ke)? |
?25歲(sui)-40歲(sui)? | ?招3~5人(ren)? | ?全職
崗位職責
1、負責視頻圖像算法，圖像接口，網絡通信在FPGA上實現，負責FPGA詳細設計、測試計劃等相關開發測試文檔編寫；
2、Verilog/VHDL代碼編寫、仿真、時序約束／分析
3、承擔新(xin)產品(pin)項目開(kai)發(fa)。
崗位要求
1、計算機或相關專業本科學歷以上；
2、3年以上FPGA工作經驗；
3、有PCIE、以太網、USB3.0、RS484、CAN等接口調試經驗，熟悉常用的TCP/IP/CANOPEN/MODBUS等通信協議；
4、有感光芯片圖像采集以及圖像處理經驗，熟悉視頻信號處理算法FPGA實現，如視頻壓縮編解碼算法、視頻縮放算法等優先；
5、有Altera/Xilinx系(xi)列FPGA芯片(pian)開發(fa)經驗，熟悉QuartusII/ISE/Modelsim等EDA軟件，熟練(lian)掌握Verilog/VHDL語言；
晉升機制
軟件開發工程師高級軟件開發工程(cheng)師項目經理項目總監CTO系(xi)統架構師資深(shen)架構(gou)師(shi)
工作地址
山東省濟寧市高新區(qu)第十一工業(ye)園
展開地圖
HR信息
李經理
3日內活躍
人力資源部
自投遞起4個工作日內答復
聊天(tian)意愿
暫無
活躍時段(duan) 冒泡 下午7-8點 最活躍
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50~100人
山東省濟寧市高新區第十(shi)一(yi)工業園
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