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山東省濟南市高新區
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| ?應屆畢業生? | ?本(ben)科? |
?年(nian)齡不(bu)限(xian)? | ?招(zhao)3~5人? | ?實習(xi)
崗位職責
1.FPGA IP 軟核的設計與研發；
2.基于HDL的數字集成電路設計與仿真，驗證與測試；
3.根據項目(mu)要求，建立IP驗證環境(jing)及測試(shi)用例的開發；
崗位要求
1.微電子、電子信息等相關專業大三大四或研究生在讀；
2.熟悉掌握FPGA/ASIC設計原理；
3.熟悉掌握Verilog HDL語言；
4.熟悉(xi)IC設計流程(cheng)及EDA常(chang)用(yong)仿真工具(ju);
晉升機制
助理(li)工(gong)程師工程師資深工程師總工(gong)程師
工作地址
山東(dong)省濟南(nan)市高新區齊魯(lu)軟(ruan)件園E座516
展開地(di)圖
HR信息
于杰
3日內活躍
HR
|
HR
| 自投遞起3個工作日內答復
聊天意愿(yuan)
暫無
活躍時段 潛水
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模擬IC設計工程師 11-11
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IC設計驗證工(gong)程師 11-11
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硬(ying)件(jian)工程師 11-11
8-15K 濟南市-高新區 | 年齡(ling)不限 | 本科
電子技術/半導體/集(ji)成電路
私營企(qi)業
50~100人
山東省濟南市高新區齊魯軟(ruan)件園(yuan)E座(zuo)516
感興趣的職位
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